第1章 EDA技術概述
1.1 EDA技術及其發展
1.2 EDA技術實現目標
1.3 硬件描述語言
1.4 HDL綜閤
1.5 自頂嚮下的設計技術
1.6 EDA技術的優勢
1.7 EDA設計流程
1.7.1 設計輸入(原理圖/HDI_.文本編輯)
1.7.2 綜閤
1.7.3 適配
1.7.4 時序仿真與功能仿真
1.7.5 編程下載
1.7.6 硬件測試
1.8 ASIC及其設計流程
1.8.1 ASIC設計簡介
1.8.2 ASIC設計一般流程簡述
1.9 常用EDA工具
1.9.1 設計輸入編輯器
1.9.2 ItDL綜閤器
1.9.3 仿真器
1.9.4 適配器
1.9.5 下載器
1.10 Quartus II概述
1.11 IP核
1.12 EDA技術發展趨勢管窺
習題
第2章 FPGA與CPLD的結構原理
2.1 PLD概述
2.1.1 PLD的發展曆程
2.1.2 PLD分類
2.2 簡單PLD結構原理
2.2.1 邏輯元件符號錶示
2.2.2 PROM結構原理
2.2.3 PLA結構原理
2.2.4 PAL.結構原理
2.2.5 GAL結構原理
2.3 CPLD的結構原理
2.4 FPGA的結構原理
2.4.1 查找錶邏輯結構
2.4.2 Cyclone III係列器件的結構原理
2.5 硬件測試
2.5.1 內部邏輯測試
2.5.2 JTAG邊界掃描
2.6 PLD産品概述
2.6.1 Altera公司的PLD器件
2.6.2 Lauicc公司的PLD器件
2.6.3 X小m公司的PLD器件
2.6.4 Acrel公司的PLD器件
2.6.5 Altera的FPGA配置方式
2.7 CPLD/PPGA的編程與配置
2.7.1 CPLD在係統編程
2.7.2 FPGA配置方式
2.7.3 FPGA專用配置器件
2.7.4 使用單片機配置FPGA
2.7.5 使用CPLD配置FPGA
習題
第3章 組閤電路的VHDL設計
3.1 多路選擇器及其VHDL描述
3.2 半加器及其VHDL描述
3.3 4選1多路選擇器及其VHDL描述
3.3.1 4選1多路選擇器及CASE語句錶述方式
3.3.2 CASE語句
3.3.3 IEEE庫預定義標準邏輯位與矢量
3.3.4 其他預定義標準數據類型
3.3.5 信號定義和數據對象
3.3.6 並置操作符&
3.3.7 4選1多路選擇器的VHDL不同描述方式
……
第4章 時序仿真與硬件實現
第5章 時序電路的VHDL設計
第6單 Quartus II應用深入
第7章 宏功能模塊應用
第8章 VHDL設計深入
第9章 VHDL設計優化
第10章 VHDL有限狀態機設計
第11章 16位實用CPU創新設計
第12章 MCU與FPGA片上係統開發
第13章 VHDL語法補充說明
第14章 VHDL Test Bench仿真
附錄 EDA開發係統及相關軟硬件
參考文獻
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